| 6ES7414-2XG01-0AB0 |
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價格： 元(人民幣) | 產地：6ES7414-2XG01-0AB0 |
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廈門光沃自動化設備有限公司
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6ES7414-2XG01-0AB0 ASIC設計一般對功耗非常，同時ASIC的時鐘樹設計又非常靈活，所以會在整個設計中經常使用門控時鐘在邏輯不需要活動的時候來去使能這些邏輯。雖然使用FPGA作為ASIC的原型可以模擬整個邏輯功能，但是二者之間的有些物理屬性，如功耗方面，還是不太一樣。 那么，要求FPGA來模擬ASIC的整個低功耗優化是沒有必要的。實際上，正是由于FPGA的粗放式的時鐘資源，讓其模擬這方面功能也是不太可能的。這一節我們將討論一些解決這個問題方法，并且再討論一些可以應用于ASIC設計的技術來使FPGA原型設計更加容易。 2.1 時鐘模塊 如果一個ASIC設計中使用了大量的門控時鐘，建議將所有這些門控操作統一放在一個專門的時鐘生成模塊中，并與功能模塊隔離，如圖16所示。
圖16：統一的時鐘模塊 通過將時鐘門控置于一個單一的模塊，不但可以是約束處理更簡單，而且當要對FPGA原型進行任何修改時也更容易。例如，如果設計者選擇某次編譯時刪除所有門控單元，那么一個單一的模塊里很容易實現。下一節我們將對此進行詳細討論。
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